Murata MULTI-7000 Especificaciones Pagina 5
- Pagina / 77
- Tabla de contenidos
- SOLUCIÓN DE PROBLEMAS
- MARCADORES
Valorado. / 5. Basado en revisión del cliente
Zynq-7000 PCB Design Guide www.xilinx.com 5
UG933 (v1.8) November 7, 2014
Chapter 6: Migration from XC7Z030-SBG485 to XC7Z015-CLG485 Devices
Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69
Differences between XC7Z030-SBG485 and XC7Z015-CLG485 Devices . . . . . . . . . . . . . . . . . . . . . . 69
Appendix A: Additional Resources and Legal Notices
Xilinx Resources . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72
Solution Centers. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73
References . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73
Please Read: Important Legal Notices . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76
- Zynq-7000 1
- All Programmable SoC 1
- PCB Design Guide 1
- Revision History 2
- Date Version Revision 3
- Table of Contents 4
- Introduction 6
- PCB Technology Basics 7
- Pads and Antipads 8
- Dimensions 9
- Transmission Lines 10
- Return Currents 11
- Power Distribution System 12
- Capacitor Specifications 15
- PCB Bulk Capacitors 16
- PCB High-Frequency Capacitors 16
- Basic PDS Principles 17
- Role of Inductance 19
- UG933_c3_04_032811 21
- UG933_c3_05_032811 21
- PCB Current Path Inductance 22
- UG933_c3_07_032811 23
- Plane Inductance 24
- AP SoC Mounting Inductance 25
- Capacitor Effective Frequency 26
- Capacitor Anti-Resonance 28
- Stabilization Capacitors 30
- Power Supply Consolidation 30
- Simulation Methods 31
- PDS Measurements 32
- UG933_c3_08_032811 33
- UG933_c3_09_032811 34
- UG933_c3_10_032811 36
- Troubleshooting 37
- SelectIO Signaling 39
- Single-Ended Signaling 40
- Input Thresholds 41
- Topographies and Termination 41
- UG933_c4_01_031711 42
- UG933_c4_02_031711 43
- UG933_c4_03_031711 43
- UG933_c4_04_031711 43
- SSTL Class I 44
- HSTL Class I 44
- UG933_c4_06_031711 46
- UG933_c4_07_031711 47
- UG933_c4_08_031711 47
- UG933_c4_09_032411 48
- UG933_c4_10_032411 48
- UG933_c4_11_031711 48
- UG933_c4_12_031711 49
- SSTL15 DCI 50
- SSTL18 CLASS II 50
- SSTL18 CLASS II DCI 50
- HSTL CLASS II 50
- HSTL CLASS II DCI 50
- Chapter 5 51
- – PS PLL Supply 52
- UG933_c5_10_020713 53
- CCO_MIO0 54
- CCO_MIO1 54
- Dynamic Memory 57
- Dynamic Memory Implementation 58
- UG585_c30_04_022814 59
- UG933_c5_05_020614 60
- DDR Supply Voltages 61
- DDR Termination 62
- DDR Trace Length 62
- DDR Trace Impedance 63
- DDR Routing Topology 63
- UG585_c30_07_091913 64
- MIO/EMIO IP Layout Guidelines 65
- Temperature Sensing Diodes 66
- USB ULPI 66
- TQSPICKD < Tckomin 67
- + 2 * T 67
- (requirement) 67
- XC7Z015-CLG485 Devices 69
- Package Differences 70
- Transceiver Differences 70
- PCB Layout Considerations 70
- Software Considerations 71
- Xilinx Resources 72
- Solution Centers 73
- References 73
- Software Documents 74
- Design Tool Documents 74
- Xilinx Problem Solvers 75
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